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【std_logic】Verilog VHDLスレ【16'hFFFF】

46 :名無しさん@3周年:03/07/26 00:51 ID:wi2inHvF
VHDLもverilogも両方よくつかうよ・・・
ASICにもっていくときはVeriのほうがおおいかな。


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